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纳秒级抖动×24h零丢帧：米尔RK3576工业级EtherCAT主站全拆解

纳秒级抖动×24h零丢帧：米尔RK3576工业级EtherCAT主站全拆解

前言：从"通用"到"硬实时"的那堵墙 在工业自动化现场，我们时常听到这样的抱怨："明明 Linux 上跑个 EtherCAT 主站协议栈很简单，可一到多轴联动、精密组装这类场景，周期一不小心就'飘'了，轨迹抖得让人心慌。" 问题就出在"硬实时"三个字上。要在... （来源：解决方案频道）

米尔RK3576工业级EtherCAT 2026-5-28 12:48

Diodes 公司的 PCIe® 7.0 时钟发生器为下一代 AI 基础设施实现低于 30fs的抖动

Diodes 公司的 PCIe® 7.0 时钟发生器为下一代 AI 基础设施实现低于 30fs的抖动

Diodes 公司（Diodes）（纳斯达克代码：DIOD）推出 PI6CG33A06，一款六输出、超低抖动时钟发生器，旨在满足PCIe Express®（PCIe®）7.0规范需求，同时兼容此前所有世代的PCIe规范。该器件于 PCI-SIG® 开发者大会上发布，面向服务器、网络设备、高性能计算（HPC）系统，以及支撑下一代 AI 基... （来源：新品频道）

Diodes PCIe时钟发生器PI6CG33A06 2026-5-7 15:24

Abracon 推出 AK1B系列超小型低抖动振荡器

Abracon 推出 AK1B系列超小型低抖动振荡器

Abracon全新的AK1B系列ClearClock®振荡器以超紧凑的2.0×1.6 mm封装实现卓越性能，为高速系统提供卓越高精度解决方案。 该振荡器提供100MHz或156.25MHz两种频率选项，在156.25MHz频率下RMS抖动可低至34.2飞秒，100MHz频率下仅54.4飞秒，确保为各类应用场景提供纯净的时钟信号。 AK1B系列... （来源：新品频道）

Abracon 振荡器 2026-1-16 11:09

【PSIJ测试应用方案】探索PSIJ之谜—由电源引起的高速信号抖动

【PSIJ测试应用方案】探索PSIJ之谜—由电源引起的高速信号抖动

PSIJ，那是一场无声的风暴在高速信号传输的世界里，每一个细微的“波动”都可能引发巨大的影响。而如今，一个隐匿的“杀手”正悄然威胁着高速信号的稳定性——那就是电源引起的高速信号抖动PSIJ（Power Supply Induced Jitter）。这个看似陌生的术语，却在电子领域掀起了一场无声的风暴。当高速信号供电... （来源：技术文章频道）

PSIJ测试 高速信号抖动 2024-9-26 10:03

【测试案例分享】信号链芯片的眼图和抖动测试

【测试案例分享】信号链芯片的眼图和抖动测试

背景信号链芯片的验证离不开抖动和眼图测量。抖动考虑的是时钟或数据过零点的时刻的不确定性，眼图则更加直观，以参考时钟的边沿为刀，将数据波形切割成无数的小段，每段波形只有 1 个 bit。然后将这些小段波形堆叠到一起，形成的眼睛形状的图片，称之为眼图。抖动和眼图是高速串行信号的必测项目。抖动... （来源：技术文章频道）

信号链芯片 眼图 抖动测试 2024-7-1 10:31

低抖动差分时钟：赋能AI时代光网络精准同步

低抖动差分时钟：赋能AI时代光网络精准同步

差分晶振是一种有源晶体振荡器，通过将晶体振荡器中的振荡信号分成两个相位相反的输出信号，并通过差分放大电路进行放大和处理，产生稳定的差分输出信号。差分晶振具有较好的抗干扰能力，能提供更稳定、更精确的时钟信号，广泛应用于通信网络、数据中心、汽车电子、工业自动化、测试测量、医疗设备等领... （来源：技术文章频道）

差分晶振 大普技术 晶体振荡器 2024-6-3 09:52

瑞萨推出兼顾超低功耗和卓越25fs－rms抖动性能的全新FemtoClock 3时钟解决方案

瑞萨推出兼顾超低功耗和卓越25fs－rms抖动性能的全新FemtoClock 3时钟解决方案

全新卓越时钟产品，面向高性能通信和数据中心应用全球半导体解决方案供应商瑞萨电子（TSE：6723）今日宣布推出适用于有线基础设施、数据中心和工业应用的全新超低25fs-rms时钟解决方案——FemtoClock™ 3，从而扩展其时钟解决方案产品阵容。新的产品家族包含8路和12路差分输出的超低抖动时钟发生器... （来源：新品频道）

瑞萨 FemtoClock 3 时钟解决方案 2024-4-19 09:24

【做信号链，你需要了解的高速信号知识（二）】高速的挑战 – 抖动和眼图

【做信号链，你需要了解的高速信号知识（二）】高速的挑战 – 抖动和眼图

作者：泰克科技中国AE Manager，余洋做高速的工程师最头疼的问题就是抖动和眼图测量Fail。抖动和眼图测量就像是一个照妖镜，任何一个设计不当，都可能会导致抖动和眼图结果的恶化，而要解决抖动和眼图问题，工程师往往无从下手。教科书上的数字信号，每个时钟周期都严格相等，每个数据UI (Unit Interva... （来源：技术文章频道）

信号链 高速信号 JESD204B 抖动眼图 2024-3-20 10:42

了解并尽量减少抖动对高速链路的影响

了解并尽量减少抖动对高速链路的影响

作者：Bill Schweber通过为系统组件确定步调，时钟振荡器为现代电路提供定时。随着系统速度提高到数百 MHz 或更高，这些时钟必须更快并具有极低的抖动，通常低于 100 飞秒 (fs)，以保持系统性能。这些时钟还必须长期保持低抖动规格，且不受温度和电压的影响。某些抖动是由信号路径噪声和失真引起的，使... （来源：技术文章频道）

抖动 高速链路 2024-1-11 11:26

时钟抖动的影响

时钟抖动的影响

抖动和相位噪声是晶振的非常重要指标，本文主要从抖动和相位噪声定义及原理出发，阐述其在不同场景下对数字系统、高速串行接口、数据转换器和射频系统的影响。1. 抖动和相位噪声1.1. 抖动1.1.1. 抖动定义和分类ITU-T G.701对抖动的定义为：“抖动是指数字信号在短期内相对于理想位置发生的偏移重大影响... （来源：技术文章频道）

时钟抖动 时钟元件大普通信 2023-6-25 13:40

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